Flip Flop JK com Clock


A topologia do flip flop JK com Clock é muito semelhante à topologia do SR com clock, que explanamos neste artigo. A diferença principal entre os dois reside na condição tal em que as entradas J e K são igual a 1. Quando isso ocorrer, não teremos um resultado ambíguo ou condição proibida, e sim o estado oposto quando ocorrer a transição. Ou seja, teremos um modo de comutação.

Abaixo temos uma típica simbologia do FF JK com Clock por transição positiva.

Simbolo

Figura 1 – Simbologia Flip Flop JK com Clock

Como comentei anteriormente, teremos apenas uma pequena diferença relacionado as entradas, que é o modo de comutação quando as entradas estiverem em nível alto. Portanto a tabela verdade ficará da seguinte forma:

TabelaVerdade

Figura 2 – Tabela Verdade Flip Flop JK

 

O gráfico abaixo ilustra melhor a saída em função da entrada de acordo com o clock.

Grafico

Figura 3 – Gráfico

 

Se você comparar com a tabela verdade mostrada anteriormente, irá observar o que acontece em cada um dos pontos enumerados, que é onde acontece a transição por borda de subida.

Ponto 1 → J e K estão em 0, portanto não há nenhuma alteração na saída.

Ponto 2 → J está em 1, K está em 0. Na transição, a saída vai a 1.

Ponto 3 → Mesmo caso que antes, portanto a saída continua em 1.

Ponto 4 → J está 0 e K está em 1, portanto nossa saída estará em 0.

Ponto 5 → Novamente J está em 1 e K em 0, nossa saída será 1.

Ponto 6 → J está em 1 e K está em 1, portanto a saída comuta, estava em 1 e vai para 0.

 

Simulação

Veja uma simulação desse tipo de circuito. Abaixo você pode ver na animação,  que efetuamos um teste alterando as entradas, porem se não atualizarmos o clock, nada acontece. Em seguida, setamos a entrada J, depois a entrada K, cada uma independente, onde após a atualização do clock, teremos o respectivo valor na saída. Por fim, quando setamos J e K em 1, e atualizar novamente o clock, nossa saída efetua a comutação.

 

Simulacao

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